Lektion 3 von 5

Tastendrücke zählen, halten zum Löschen

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// KEY0-Drücke auf den LEDs zählen; KEY1 eine Sekunde halten zum Löschen. module top #( parameter CLK_HZ = 50_000_000 ) ( input MAX10_CLK1_50, input [1:0] KEY, // 0, solange gedrückt, auf dem Board entprellt output [9:0] LEDR ); // 1. Synchronisieren: Zwei Flipflops bringen jeden Taster auf unseren Takt. reg [1:0] k0 = 2'b11; reg [1:0] k1 = 2'b11; always @(posedge MAX10_CLK1_50) begin k0 <= {k0[0], KEY[0]}; k1 <= {k1[0], KEY[1]}; end // 2. Flanke: ein Impuls von einem Takt Länge, wenn KEY0 von 1 auf 0 geht. wire press = k0[1] & ~k0[0]; // 3. Halten: Zyklen zählen, solange KEY1 unten ist; eine volle Sekunde löscht. localparam HOLD = CLK_HZ; reg [31:0] held = 0; always @(posedge MAX10_CLK1_50) begin if (k1[1]) held <= 0; else if (held != HOLD) held <= held + 1; end wire clear = (held == HOLD - 1); // 4. Die Drücke zählen; Löschen hat Vorrang. reg [9:0] count = 0; always @(posedge MAX10_CLK1_50) begin if (clear) count <= 0; else if (press) count <= count + 1; end assign LEDR = count; endmodule

Gestoppt · Dein Code läuft noch nicht. Bis du auf „Ausführen“ drückst, läuft das Programm, das schon auf dem Board ist.

Noch nichts ausgegeben. Drück auf „Ausführen“.

Jeder Druck auf KEY0 zählt eine Binärzahl auf den LEDs um eins hoch. Ein kurzes Antippen von KEY1 bewirkt nichts; eine Sekunde Halten löscht den Zähler.

Synchronisieren und die fallende Flanke finden
Antippen und Halten durch Zählen von Zyklen unterscheiden
Taster auf dem Board entprellt

iynk führt dein Verilog als Verhaltensmodell aus, Takt für Takt am Takt des Boards. Es wird nicht synthetisiert, platziert oder geroutet: kein Timing, keine LUT-Zahlen.

Pin	Verbunden mit	Aufgabe
`KEY0`	U14 → PIN_B8 (KEY[0])	Jeder Druck zählt eins hoch
`KEY1`	U14 → PIN_A7 (KEY[1])	Eine Sekunde halten zum Löschen
`LEDR0`	PIN_A8 (LEDR[0])	Bit 0 des Zählers

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Sensoren und Aktoren, die dieses Board ansteuert, mit den echten Verbindungen.

Alle 7 Bauteile auf der Seite Terasic DE10-Lite

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